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=== 针脚 ===
地址总线拥有自己的16个针脚，而数据总线有8个可用的针脚，无需任何复用。使用另外两个针脚（读和写信号），可以非常容易地组装简单的微处理器设备。仅需为独立的IO空间、中断和DMA添加解码处理器针脚信号的芯片。

然而，针脚的负载能力是有限的；即使是简单的计算机通常也需要总线放大器。

处理器需要三个电源（-5V、+5V和+12V）和两个非重叠的高幅度同步信号。然而，至少在苏联后期的版本КР580ВМ80А能够仅使用单一的+5V电源工作，将+12V针脚连接到+5V，将-5V针脚接地。

随芯片提供的文档中的针脚布局表，如下描述针脚：
{| class="wikitable"
!针脚
!信号
!类型
!指令
|-
|1
|A10
|Output
|地址总线10
|-
|2
|GND
|—
|地
|-
|3
|D4
| rowspan="8" |Bidirectional
| rowspan="8" |双向数据总线，处理器还会暂时在此设置“处理器状态”，提供有关处理器当前正在执行的操作的信息：

* D0 读取中断命令。响应中断信号时，处理器正在读取并执行一个带有此标志的任意命令。通常，支持芯片会提供子程序调用命令（CALL或RST），将控制权转移到中断处理代码
* D1 读取（低电平意味着写入）
* D2 访问堆栈（可能最初计划了一个单独的堆栈内存空间）
* D3 无操作，已被HLT指令停止
* D4 向输出端口写入数据
* D5 读取可执行指令的第一个字节
* D6 从输入端口读取数据
* D7 从内存读取数据
|-
|4
|D5
|-
|5
|D6
|-
|6
|D7
|-
|7
|D3
|-
|8
|D2
|-
|9
|D1
|-
|10
|D0
|-
|11
|−5 V
|—
| -5伏电源供应。这必须是首先连接的电源，并且是最后断开的电源，否则处理器将会受损
|-
|12
|RESET
|Input
|复位。该信号强制执行位于0000地址的命令。其他处理器寄存器的内容不会被修改。这是一个反相输入（激活电平为逻辑0）
|-
|13
|HOLD
|Input
|直接内存访问请求。请求处理器将数据和地址总线切换到高阻抗（“断开连接”）状态
|-
|14
|INT
|Input
|中断请求
|-
|15
|φ2
|Input
|时钟发生器信号的第二相位
|-
|16
|INTE
|Output
|处理器拥有两个命令，用于在该引脚上设置0或1电平。这个引脚通常被用于中断控制。然而，在简单的计算机中，它有时被用作单比特输出端口，用于各种目的
|-
|17
|DBIN
|Output
|读(处理器从内存或输入端口读取数据)
|-
|18
|WR
|Output
|写(处理器向内存或输出端口写入数据。这是一个反向输出，激活电平为逻辑零)
|-
|19
|SYNC
|Output
|激活电平表明处理器已经将“状态字”放置在数据总线上。这个状态字的各个位提供了额外的信息，以支持独立的地址和内存空间、中断和直接内存访问。这个信号在可以用于将数据总线上的处理器状态字写入某个外部寄存器之前，需要通过额外的逻辑处理，例如，[http://www.datasheets360.com/pdf/-4828066515233335508 8238] {{Wayback|url=http://www.datasheets360.com/pdf/-4828066515233335508 |date=20230918030959 }}系统控制器和总线驱动器
|-
|20
| +5 V
|—
| +5伏电源供应
|-
|21
|HLDA
|Output
|直接内存访问确认。处理器将数据和地址引脚切换到高阻抗状态，允许其他设备操纵总线
|-
|22
|φ1
|Input
|时钟发生器信号的第一相位
|-
|23
|READY
|Input
|等待(利用这个信号，可以暂停处理器的工作。它还用于支持基于硬件的逐步调试模式)
|-
|24
|WAIT
|Output
|等待(指示处理器处于等待状态)
|-
|25
|A0
| rowspan="3" |Output
| rowspan="3" |地址总线
|-
|26
|A1
|-
|27
|A2
|-
|28
|12 V
|—
| +12伏电源供应，这必须是最后连接和第一个断开的电源
|-
|29
|A3
| rowspan="12" |Output
| rowspan="12" |地址总线；可以根据需求切换到高阻抗状态
|-
|30
|A4
|-
|31
|A5
|-
|32
|A6
|-
|33
|A7
|-
|34
|A8
|-
|35
|A9
|-
|36
|A15
|-
|37
|A12
|-
|38
|A13
|-
|39
|A14
|-
|40
|A11  
|}